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该系统采用高速ECL电路，采用CPLD技术实现精密延时系统的设计。着重讨论了实现高精度精密延时的原理和方法。基于高速数字逻辑器件实现可预置计数器设计并产生大时间的数字延时，高精度集成可编程延时芯片实现短延时调节.采用双相位双路计数技术和恒流源电容线性充电延时法相结合，最终实现高精度精密延时。
基于ECL电路的高速计数及可编程精密延时系统设计
【摘 要】
：
该系统采用高速ECL电路，采用CPLD技术实现精密延时系统的设计。着重讨论了实现高精度精密延时的原理和方法。基于高速数字逻辑器件实现可预置计数器设计并产生大时间的数字延
【机 构】
：
中国工程物理研究院电子工程研究所 四川 绵阳 621900
【出 处】
：
全国信息与电子工程第四届学术年会暨四川省电子学会曙光分会第十五届学术年会
【发表日期】
：
2010年期
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