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利用全同步频率测量原理，通过FPGA芯片在Max＋PlusⅡ中运用VHDL语言编程设计一个全同步数字式频率计，消除了±1个计数误差，测频精度范围在DC～100MHz，详细给出了VHDL的模块设计方法和仿真波形。
全同步数字频率计的VHDL设计与仿真
【摘 要】
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利用全同步频率测量原理，通过FPGA芯片在Max＋PlusⅡ中运用VHDL语言编程设计一个全同步数字式频率计，消除了±1个计数误差，测频精度范围在DC～100MHz，详细给出了VHDL的模块设计方
【机 构】
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湖南科技学院,湖南大学电气学院
【出 处】
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现代电子技术
【发表日期】
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2007年20期
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