【摘 要】
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设计全自检线路,是提高数字线路可靠性的有效方法。本文给出了将任意组合函数设计为全自检线路,以及具有编码分离性质的全自检线路的方法。本文将这些设计方法应用于同步时序
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设计全自检线路,是提高数字线路可靠性的有效方法。本文给出了将任意组合函数设计为全自检线路,以及具有编码分离性质的全自检线路的方法。本文将这些设计方法应用于同步时序机,进一步给出了设计全自检Moor型时序机和Mealy型时序机的方法。上述设计采用的编码是奇偶码。所针对的故障是单故障。
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