【摘 要】
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在比较反转触发器(TFF)的各种结构的基础上,给出了一种单时钟信号控制实现超高速分频的电路结构,以及具体设计过程。分频器使用动态负载,输出两路互补信号。采用SMIC 0.18um
【机 构】
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东华理工大学电子与机械工程学院,华中科技大学电子科学与技术系,
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在比较反转触发器(TFF)的各种结构的基础上,给出了一种单时钟信号控制实现超高速分频的电路结构,以及具体设计过程。分频器使用动态负载,输出两路互补信号。采用SMIC 0.18um 1P6M CMOS工艺,在电源电压为1.8V的情况下,仿真实现了工作速度10GHz(可工作频率范围为1~13.5GHz)、功耗仅为3.1mW的二分频器,可用于超高速锁相环、时钟数据恢复设计中。
Based on the comparison of various structures of TFF, a circuit structure of single-clock signal control to realize ultra-high-speed frequency division and a detailed design process are given. The divider uses a dynamic load to output two complementary signals. SMIC 0.18um 1P6M CMOS process, the supply voltage of 1.8V case, the simulation of the operating speed of 10GHz (operating frequency range of 1 ~ 13.5GHz), power consumption of only 3.1mW of the second frequency divider can be used to Ultra-high-speed PLL, clock data recovery design.
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