【摘 要】
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设计了一个12位,采样速率为120kS/s的SAR ADC。提出了一种12位精度下,能在电容面积和精度之间进行折中的算法,使得电容的整体面积、速度和功耗达到优化。通过对比较器的设计,
【机 构】
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中国电子科技集团公司第二十四研究所,模拟集成电路重点实验室,
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设计了一个12位,采样速率为120kS/s的SAR ADC。提出了一种12位精度下,能在电容面积和精度之间进行折中的算法,使得电容的整体面积、速度和功耗达到优化。通过对比较器的设计,解决了在噪声环境下,影响比较器性能的电荷注入、带宽、转换速度等问题。在0.35μm2P5MCMOS工艺下进行了流片,测试结果表明,设计的SAR ADC的DNL和INL均小于±1LSB,功耗为1.5mW。
A 12-bit SAR ADC with a sampling rate of 120kS / s is designed. A 12-bit precision algorithm that can compromise between the capacitance area and the accuracy is proposed to optimize the overall area, speed, and power dissipation of the capacitor. The design of the comparator solves the problems of charge injection, bandwidth and conversion speed that affect the performance of the comparator in noisy environments. The flow sheet was tested under the 0.35μm2P5MCMOS process. The test results show that the DNL and INL of the designed SAR ADC are both less than ± 1LSB and the power consumption is 1.5mW.
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