【摘 要】
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该文所涉及的研究工作旨在开发DVB数据广播PC接收卡核心芯片中的条件接收解扰模块,并通过与其他模块的结合,开发出拥有完全自主产权的DVB接收芯片,从而找到一条既不失技术的
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该文所涉及的研究工作旨在开发DVB数据广播PC接收卡核心芯片中的条件接收解扰模块,并通过与其他模块的结合,开发出拥有完全自主产权的DVB接收芯片,从而找到一条既不失技术的先进性又适合中国国情的DVB数据广播芯片开发之路.条件接收解扰模块的开发过程采用了目前比较先进设计方法与设计工具.在设计的前期使用了UNIX系统的C编译环境对算法进行了验证.随后,利用了Cadence公司的Verilog_XL编写了整个模块的Verilog的代码并进行了仿真.在设计的功能验证阶段,我们使用了Altera公司的FPGA芯片APEX 20K400E,并针对该芯片设计了验证平台,同时采用Altera公司的设计工具QUARTUS II将Verilog代码进行了改造,编译,并通过MasterBlaster下载到验证平台上.然后利用Tektronic公司的MPEG传输码流发生/分析仪MTS300和Agilent公司的数字逻辑分析仪1670A对验证平台进行了功能验证.
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