【摘 要】
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在北京正负电子对撞机重大改造项目(BEPCⅡ)中，定时系统承担的任务是对储存环以及电子直线加速器的各部分设备提供同步信号，从而协调整个对撞机系统的正常运行。在定时系统中，需
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在北京正负电子对撞机重大改造项目(BEPCⅡ)中，定时系统承担的任务是对储存环以及电子直线加速器的各部分设备提供同步信号，从而协调整个对撞机系统的正常运行。在定时系统中，需要使用到锁相环，将储存环和直线加速器的高频信号相互锁定。另外需要鉴别储存环上不同位置高频信号的相位差。这些都会用到鉴相器。
原BEPC定时系统中所使用的为模拟鉴相器，鉴相精度较低，且易受温度以及湿度变化的影响。BEPCⅡ储存环高频频率从199MHz提高到499.8MHz，对定时系统各部分的精度以及功能都有了更高更多的要求，研制高性能的鉴相器，对于保证BEPCⅡ定时系统的整体性能有着十分重要的意义。本论文主要研究基于CPLD以及DSP芯片设计的差分数字鉴相器。
本文描述了BEPCⅡ定时系统中鉴相器的设计原理和研制，用于对不同途径传输的两路499.8MHz信号的相位进行鉴别。该鉴相器采用纯数字电路，不易受温度以及湿度的影响。鉴相器采用数字采样原理，通过增加采样点至2000个，使鉴相精度在499.8MHz频率时达到1度以内。由于采用DSP与CPLD的架构，方便了对鉴相器进行优化和改进。
鉴相器的测试结果表明，其鉴相精度达到1度以内，且线性度较好。鉴相器带有数字和模拟输出，数字输出的信噪比非常高，不易受到干扰。
对于BEPCⅡ来说，数字鉴相器的研制是一个新的课题。作为BEPCⅡ定时系统中的一个重要组成部分，储存环和直线加速器的锁相环可以减小注入束团的时间抖动，有利于提高储存环注入效率，对于BEPCⅡ工程有着较大的现实意义。
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