【摘 要】
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论文以电路和器件的结合点即版图设计为主要研究内容,按照全定制设计流程,设计出了电路和版图.该项设计,特别是版图设计,是国内首次实现的.论文以高速浮点加法器、输入输出接
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论文以电路和器件的结合点即版图设计为主要研究内容,按照全定制设计流程,设计出了电路和版图.该项设计,特别是版图设计,是国内首次实现的.论文以高速浮点加法器、输入输出接口和时钟驱动等设计难点为研究对象.以版图设计为目标,综合考虑了CMOS器件结构和特性、芯片面积和工作速度,以及版图各功能部件之间的物理连接等设计要点.从而完成了协处理器的物理实现.所设计的芯片面积为7×7mm<2>,包含约2万个逻辑门10万个晶体管.经实测,其工作速度最高可达15MHz.论文所采用的算法、设计流程和方法不仅可应用于协处理器版图设计,还可用于其它类似电路的版图实现过程中.
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