视频解码器中多路并行输出的硬件实现

来源 :2009年系统仿真技术及其应用学术会议(CCSSTA'2009) | 被引量 : 0次 | 上传用户：passcardaj

【摘要】

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本文提出了一种支持AVS和H.264/AVC两种标准的解码器中多路并行输出的DF(Display Fceder)硬件结构，这种结构采用多路并行帧缓存和三级片上缓存的方法，使得片外存储器数据带宽减

【作者】

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陈溶波刘肃尹晓丽

【机构】

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兰州大学物理科学与技术学院，甘肃，兰州，730000

【出处】

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2009年系统仿真技术及其应用学术会议(CCSSTA'2009)

【发表日期】

：

2009年期

【关键词】

：

视频解码器多路并行并行输出硬件结构外存储器图像尺寸数据读取实时解码帧缓存速率设计宽减标准

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本文提出了一种支持AVS和H.264/AVC两种标准的解码器中多路并行输出的DF(Display Fceder)硬件结构，这种结构采用多路并行帧缓存和三级片上缓存的方法，使得片外存储器数据带宽减少25％且数据读取速率提高将近三倍，FPGA验证表明本设计下的解码器可以实现对30Hz总图像尺寸不超过1920×1080的多路图像实时解码和输出.

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