【摘 要】
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本文描述了一种嵌入式处理器IP核的调试电路结构设计方法,重点讲述了在片调试系统的设计,同时讲了相关调试流程.调试系统使用仿真器使得调试器与处理器CORE内核通过JTAG接口
【机 构】
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信息产业部软件与集成电路促进中心(CSIP),中国 北京 100038
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本文描述了一种嵌入式处理器IP核的调试电路结构设计方法,重点讲述了在片调试系统的设计,同时讲了相关调试流程.调试系统使用仿真器使得调试器与处理器CORE内核通过JTAG接口进行通信.调试器通过JTAG扫描链取指方式将指令插入到处理器CORE内核中去执行.片内配置两条扫描链,分别对应片内调试模块和存储器读写总线,事实上,内核的扫描链在用作调试的同时,也可作为测试使用。
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