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【摘 要】
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选取具有数字接口、高度集成的锁相环（PLL）电路,实现了C频段5.4-6.4 GHz带宽内输出频率数控可变、步进间隔为50 kHz的宽带集成锁相源的设计方案。按照该设计方案制作完成了具体
【机 构】
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空军工程大学导弹学院,解放军95037部队
【出 处】
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电讯技术
【发表日期】
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2009年9期
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