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采用层次化的设计思想,先将IIR滤波器分为四个功能模,然后用VHDL语言分别对各模块进行设计,最后完成整个滤波器的设计,并对设计结果进行了仿真。仿真结果表明,设计的IIR数字滤波器运算速度较快。
基于FPGA的级联型IIR数字滤波器的设计
【摘 要】
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采用层次化的设计思想,先将IIR滤波器分为四个功能模,然后用VHDL语言分别对各模块进行设计,最后完成整个滤波器的设计,并对设计结果进行了仿真。仿真结果表明,设计的IIR数字
【机 构】
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四川理工学院自动化与电子信息学院
【出 处】
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中国西部科技
【发表日期】
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2011年23期
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