【摘 要】
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介绍了一种基于全数字锁相环（All Digtal Phase Locked Loop,简称ADPLL）电路实现电网频率跟踪的技术。分析比较了电网频率跟踪技术中软、硬件同步的优缺点,并将FPGA技术运用到
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介绍了一种基于全数字锁相环（All Digtal Phase Locked Loop,简称ADPLL）电路实现电网频率跟踪的技术。分析比较了电网频率跟踪技术中软、硬件同步的优缺点,并将FPGA技术运用到电网同步跟踪技术中,解决了软、硬同步方法的不足。阐述了该技术的实现原理和各个模块的设计。ADPLL电路采用VHDL语言和现场可编程门阵列（Filed Programmable Gata Array,简称FPGA）设计实现,并采用QUARTUSⅡ软件进行仿真研究。仿真和实验结果表明,该方法能够很好地跟踪电网频
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