基于FPGA的突发通信系统的频偏估计算法实现

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提出了一种短脉冲两端加同步头的帧格式,利用两端同步头对接收数据进行频偏估计,并通过多个短脉冲叠加可进一步提高估计精度,最后,将所得估计值补偿被干扰数据以及数字振荡器。在此基础上,本文详细阐述了算法关键模块的电路结构和硬件实现。仿真结果表明该算法在突发通信环境下具有较高的频偏估计精度,能够有效地降低硬件资源消耗,节省传输带宽。
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