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提出了一种H．264／AVC硬件解码器的SOC／ASIC设计方案，并在实现电路的基础上，重点分析了基于文中的硬件设计方案的验证策略。该设计方案已经在基于FPGA的验证平台上通过功能原型验证，结果证明，这是一个完全可行的H．264／AVC硬件解码设计方案。
H．264／AVC硬件解码器设计及其验证策略
【摘 要】
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提出了一种H．264／AVC硬件解码器的SOC／ASIC设计方案，并在实现电路的基础上，重点分析了基于文中的硬件设计方案的验证策略。该设计方案已经在基于FPGA的验证平台上通过功能原型验证
【机 构】
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同济大学超大规模集成电路研究所
【出 处】
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微电子学
【发表日期】
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2006年1期
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