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为了加快微处理器中线性地址向物理地址转换的速度，提出了一种高速TLB结构。结构采用全定制的CAM阵列和SRAM阵列，并根据CAM和SRAM单元的输出特点设计了精巧的读出放大逻辑，有效提高了TLB的读出速度。经流片测试，表明设计正确可靠，能够保证地址转换延时在1ns
一种高速TLB的设计与实现
【摘 要】
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为了加快微处理器中线性地址向物理地址转换的速度，提出了一种高速TLB结构。结构采用全定制的CAM阵列和SRAM阵列，并根据CAM和SRAM单元的输出特点设计了精巧的读出放大逻辑，有效
【机 构】
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国防科技大学计算机学院
【出 处】
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计算机工程与应用
【发表日期】
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2007年16期
【基金项目】
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国家自然科学基金（the National Natural Science Foundation of China under Grant No.60473079）.
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