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本文将从边界扫描路径,测试体系结构,测试状态定义,测试指令安排与板级测试策略五个方面,介绍VLSI电路可测试性设计的JTAG方式.
可测试性设计的JTAG方法
【摘 要】
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本文将从边界扫描路径,测试体系结构,测试状态定义,测试指令安排与板级测试策略五个方面,介绍VLSI电路可测试性设计的JTAG方式.
【机 构】
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陕西微电子学研究所
【出 处】
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小型微型计算机系统
【发表日期】
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1991年1期
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