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采用良好的时序约束方法,使FPGA的静态时序分析结果更接近实际电路。文中简述了FPGA静态时序分析（STA）中时序约束的基本概念,重点针对时序分析中群组定义、时钟域、端口信号等关键时序问题给出了时序约束方法,并通过实例演示进行了说明。
FPGA静态时序约束方法分析
【摘 要】
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采用良好的时序约束方法,使FPGA的静态时序分析结果更接近实际电路。文中简述了FPGA静态时序分析（STA）中时序约束的基本概念,重点针对时序分析中群组定义、时钟域、端口信号等
【机 构】
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中国空间技术研究院西安分院
【出 处】
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空间电子技术
【发表日期】
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2017年5期
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