RTL组合电路描述的Verilog HDL编译器的设计

来源 :湖南大学学报(自然科学版) | 被引量 : 0次 | 上传用户：guojinwenv1

【摘要】

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设计了一个针对ISCAS 85/89 Benchmark,用于RTL组合电路Verilog HDL描述的编译器.这个编译器可以作为RTL电路测试研究的辅助工具.在对Verilog HDL和RTL描述的特点进行分析的

【作者】

：

陈骥邝继顺张大方

【机构】

：

湖南大学计算机科学系

【出处】

：

湖南大学学报(自然科学版)

【发表日期】

：

2001年4期

【关键词】

：

VERILOGHDL ISCAS85/89Benchmark 寄存器传送级描述编译器电路测试 RTL组合电路设计 Verilog HDLISCAS85/8

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设计了一个针对ISCAS 85/89 Benchmark,用于RTL组合电路Verilog HDL描述的编译器.这个编译器可以作为RTL电路测试研究的辅助工具.在对Verilog HDL和RTL描述的特点进行分析的基础上,阐述了该编译器解析Verilog HDL描述、创建功能模块类库和将RTL描述转化为无层次分块的门级描述的基本原理,提出了主要问题的解决策略.

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