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介绍了一种在FPGA中可实现的FIR滤波器结构。该结构采用并行加流水线设计技术，可在40MHz的速率下运行。探讨了实现中的具体细节，用切比雪夫一致逼近法设计了滤波器并给出了仿真结果。硬件实现结果完全满足指标要求。
高采样率FIR滤波器的FPGA实现
【摘 要】
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介绍了一种在FPGA中可实现的FIR滤波器结构。该结构采用并行加流水线设计技术，可在40MHz的速率下运行。探讨了实现中的具体细节，用切比雪夫一致逼近法设计了滤波器并给出了仿真
【机 构】
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海军大连舰艇学院,海工大电子工程学院
【出 处】
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海军工程大学电子工程学院学报
【发表日期】
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2001年4期
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