【摘 要】
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为了提高模型机指令执行的并行性,使用Verilog HDL并采取top-down设计方法,利用确定的有限状态自动机(DFA)理论,设计并实现了一台具有指令级并行性的流水线模型机的方案.阐述
【机 构】
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北京工业大学计算机学院,北京工业大学计算机学院 北京100022,北京100022
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为了提高模型机指令执行的并行性,使用Verilog HDL并采取top-down设计方法,利用确定的有限状态自动机(DFA)理论,设计并实现了一台具有指令级并行性的流水线模型机的方案.阐述了该流水线模型机的DFA设计算法与Verilog HDL的实现方法,并给出了相应的仿真测试.测试结果证明,该模型机能并行处理4条指令,并具有预取指令和旁路功能.
In order to improve the parallelism of the execution of model machine instructions, a solution of pipeline model machine with instruction level parallelism was designed and implemented using Verilog HDL and top-down design method with finite finite state machine (DFA) theory. The design method of DFA and the implementation of Verilog HDL are introduced, and the corresponding simulation tests are given.The test results show that the model can process 4 instructions in parallel and have prefetch instructions and bypass functions.
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