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针对高速信号处理领域中,系统所需的高性能稳定的高速时钟电路的设计进行研究。采用了一种具有可编程配置的高速时钟芯片ADF4360-7,并利用CPLD完成对芯片的配置,其时钟输出频率范围在350MHz～1.8GHz,且功率输出可配置。经过系统实际测试,满足系统技术指标要求,具有较好的工程应用价值。
可编程高速时钟电路设计与实现
【摘 要】
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针对高速信号处理领域中,系统所需的高性能稳定的高速时钟电路的设计进行研究。采用了一种具有可编程配置的高速时钟芯片ADF4360-7,并利用CPLD完成对芯片的配置,其时钟输出频
【机 构】
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黑龙江省实验中学,哈尔滨工程大学信息与通信工程学院
【出 处】
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黑龙江科学
【发表日期】
：
2010年6期
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