应用于超宽带收发机的多相时钟生成器的设计

来源 :微电子学与计算机 | 被引量 : 1次 | 上传用户：NoNameMan

【摘要】

：

设计了一款用于超宽带(UWB)收发机的多相位基带时钟生成器.该时钟生成器通过分析锁相环(PLL)和延时锁定环(DLL)结构的共性,提出了一种全匹配的压控振荡器/压控延时线(VCO/VCDL)双模可配置结构,使时钟生成器可以分别在PLL/DLL两种模式下工作,为UWB收发机提供2GHz 10相位的基带时钟信号.该电路基于TSMC 65nm CMOS工艺设计实现,有效面积为0.03mm2.根据测试结果

【作者】

：

刘小峰刘铛李宇根王志华

【机构】

：

清华大学微电子学研究所

【出处】

：

微电子学与计算机

【发表日期】

：

2016年21期

【关键词】

：

超宽带收发机多相时钟生成锁相环延时锁定环双模可配置 UWB transceiver multiphase clock generation PLL

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