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本文介绍了基于FPGA/CPLD的嵌入式VGA显示系统的设计,详细讨论了用VHDL设计行场扫描时序的方法,这种设计方法稍作改动便可产生任意行场扫描时序,具有很好的移植性。该显示系统已成功地在雷达图形显示系统中使用,且显示器的分辨率达到了1280*1024,刷新频率为60Hz。
基于FPGA/CPLD的嵌入式VGA显示系统
【摘 要】
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本文介绍了基于FPGA/CPLD的嵌入式VGA显示系统的设计,详细讨论了用VHDL设计行场扫描时序的方法,这种设计方法稍作改动便可产生任意行场扫描时序,具有很好的移植性。该显示系
【机 构】
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湖北省武汉科技大学信息科学与工程学院
【出 处】
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微计算机信息
【发表日期】
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2008年26期
【基金项目】
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湖北省教育厅科学研究计划项目(2003A006)
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