【摘 要】
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采用自顶向下的设计方法，对高速同步串行接口电路进行了详细的研究。在寄存器配置单元中，通过多参数的设置实现高速同步串行接口的可配置，使用灵活，兼容性强。利用VHDL语言对SSC
【机 构】
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江南大学物联网学院,中国电子科技集团公司第58研究所
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采用自顶向下的设计方法，对高速同步串行接口电路进行了详细的研究。在寄存器配置单元中，通过多参数的设置实现高速同步串行接口的可配置，使用灵活，兼容性强。利用VHDL语言对SSC接口电路进行描述，并通过仿真和验证。采用TSMC65nm工艺库，总线时钟为150MHz时，最大数据传输速率可达75Mbit／s，面积为11868um2，功耗为416．8uW，很好地满足了设计要求，可广泛应用于数字信号处理系统中。
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