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本文采用VHDL语言，运用自顶向下的设计思想，将系统按功能逐层分割的层次化设计方法，使用MUX＋plus2集成开发环境进行编辑，逻辑综合自动的把VHDL描述转变门级电路，然后进行渡形仿真，最后通过编程电缆将所设计的内容下载到CPLD器件中．最终实现了电子钟的设计。
一种基于VHDL语言的电子钟的设计与实现
【摘 要】
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本文采用VHDL语言，运用自顶向下的设计思想，将系统按功能逐层分割的层次化设计方法，使用MUX＋plus2集成开发环境进行编辑，逻辑综合自动的把VHDL描述转变门级电路，然后进行渡形仿真，最
【机 构】
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邢台职业技术学院电气系
【出 处】
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中国高新技术企业
【发表日期】
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2008年15期
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