【摘 要】
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充分利用有限冲击响应数字滤波器（Finite Impulse Response digital filter,FIR）系数的对称特性,借助于MAT-LAB语言和现场可编程门阵列（FPGA）实现了一种高效的低通滤波器。设计过
【机 构】
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新疆师范大学物理与电子工程学院,南京理工大学电光学院
【基金项目】
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国家部委基金（9140A05060209BQ0210）, 江苏省普通高校研究生科研创新计划项目（AD20328）
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充分利用有限冲击响应数字滤波器（Finite Impulse Response digital filter,FIR）系数的对称特性,借助于MAT-LAB语言和现场可编程门阵列（FPGA）实现了一种高效的低通滤波器。设计过程中通过简化的VHDL语言编写程序,实现了加减乘法运算,使用优化的CSD编码技术缩短了乘法器的运算时间,采用FPGA滤波器芯片和QuartusⅡ软件搭建仿真电路、用Matlab软件进行理论验证。实验结果基本符合理论值,验证了此种滤波器的实现方法简单,计算速度快,节省硬件资源,抗干扰能力强
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