【摘 要】
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设计了一种基于AXI4.0总线的互联架构。该互联架构的可配置性较高,主要包括:master与slave数量可配置、地址译码范围可配置、master端与slave端的仲裁方式可配置、总线地址位
【机 构】
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中国科学院大学,中国科学院微电子研究所
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设计了一种基于AXI4.0总线的互联架构。该互联架构的可配置性较高,主要包括:master与slave数量可配置、地址译码范围可配置、master端与slave端的仲裁方式可配置、总线地址位宽,数据位宽可配置、burst传输长度可配置、slave可视性可配置等等,这使得该互联架构的使用非常灵活,可以适用不同的SoC场景,除此之外,设计的互联架构可以避免多master与多slave同时访问造成的乱序死锁,针对某些特殊情况可优化互联架构的电路结构,且留出用户自定义端口方便用户扩展使用。该互联架构较容易实现,可
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