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简述了基于锁相环（PLL）的实时同步采样方法的基本原理，详细介绍了一种抗干扰性强、通用性较好的同步采样时钟发生器的理论基础、设计方法和实际电路。实验表明，该电路能有效抑制噪音、谐波和频率波动等电能质量扰动的影响；且在不同应用场合，只要对电路中阻容值进行对应调整即可，无需重新设计电路。
电能质量监测中同步采样时钟发生器的设计
【摘 要】
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简述了基于锁相环（PLL）的实时同步采样方法的基本原理，详细介绍了一种抗干扰性强、通用性较好的同步采样时钟发生器的理论基础、设计方法和实际电路。实验表明，该电路能有效抑制
【机 构】
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上海交通大学
【出 处】
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电子测量技术
【发表日期】
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2008年6期
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