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本文介绍了神经网络VLSI硬件实现的基本情况和VerilgHDL硬件设计方法的概念,在此基础上利用FPGA设计出了Kohonen竞争网络硬件电路,其工作频率为33Mhz,并对其工作过程进行了较详细的分析,给出了综合仿真的测试结果.
基于FPGA的Kohonen竞争网络硬件实现
【摘 要】
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本文介绍了神经网络VLSI硬件实现的基本情况和VerilgHDL硬件设计方法的概念,在此基础上利用FPGA设计出了Kohonen竞争网络硬件电路,其工作频率为33Mhz,并对其工作过程进行了较
【机 构】
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100083
【出 处】
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微计算机信息
【发表日期】
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2004年11期
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