【摘 要】
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针对传统锁相环的位同步方法电路设计复杂、链路适应性差等问题,提出基于数字锁相环的无人机测控链通用位同步方法。该方法将传统锁相环与内插调整鉴相方法结合,在不改变本地
【机 构】
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陆军工程大学石家庄校区,电子科技大学通信抗干扰国家级重点实验室
【基金项目】
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国家自然科学基金项目资助(61531009,61471108),国家重大专项基金项目资助(2016ZX03001009)
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针对传统锁相环的位同步方法电路设计复杂、链路适应性差等问题,提出基于数字锁相环的无人机测控链通用位同步方法。该方法将传统锁相环与内插调整鉴相方法结合,在不改变本地时钟的条件下实现了位定时时刻的调整。基于FPGA设计并实现了全数字位同步锁相环电路,通过数字电路定点仿真验证了电路的有效性及同步性能。仿真结果表明,该方法在位同步过程中所需采样点少,易于高速实现,适合在软件无线电平台上实现,且具有定时误差检测性能不受载波相位恢复影响的优点,具有一定的通用性,可应用于其他无人机测控链位同步电路中。
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