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介绍了在FPGA芯片上实现数字频率计的原理。对各种硬件除法进行了比较，提出了高速串行BCD码除法的硬件算法，并将其应用在频率计设计中。
基于高速串行BCD码除法的数字频率计的设计
【摘 要】
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介绍了在FPGA芯片上实现数字频率计的原理。对各种硬件除法进行了比较，提出了高速串行BCD码除法的硬件算法，并将其应用在频率计设计中。
【机 构】
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山东大学信息科学与工程学院250100
【出 处】
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电子技术应用
【发表日期】
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2004年8期
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