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低效率的访存操作是限制微处理器性能提高的一个关键因素。本文提出了一种Ｌｏａｄ／Ｓｔｏｒｅ缓冲模型，分析了这种模型协调微处理器和存储器之间速度差异的作用和提高访存效率的机理，讨论了适合于ＩＣ设计的四种实现方案，并且在微处理器ＮＲＳ４０００的设计中得到应用，取得了良好的效果。
微处理器设计中提高访存效率的一种方法
【摘 要】
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低效率的访存操作是限制微处理器性能提高的一个关键因素。本文提出了一种Ｌｏａｄ／Ｓｔｏｒｅ缓冲模型，分析了这种模型协调微处理器和存储器之间速度差异的作用和提高访存效率的机理，讨论了适合于
【机 构】
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西北工业大学
【出 处】
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西北工业大学学报
【发表日期】
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1999年3期
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