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基于软判决译码规则，采用完全并行的解码结构，使用Verilog硬件描述语言，在Xilinx公司的FPGA(Virtex-2xcv1000)上实现了码率为1／2、帧长为20bit的规则(3，6)LDPC码的译码器，最大传输速率可达20Mbps。对LDPC码的实际应用具有重要的推动作用。
基于FPGA的规N（3，6）LDPC码译码器
【摘 要】
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基于软判决译码规则，采用完全并行的解码结构，使用Verilog硬件描述语言，在Xilinx公司的FPGA(Virtex-2xcv1000)上实现了码率为1／2、帧长为20bit的规则(3，6)LDPC码的译码器，最大传输
【机 构】
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厦门大学电子工程系361005
【出 处】
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电子技术应用
【发表日期】
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2004年12期
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