【摘 要】
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为了解决超高速无采保流水线型ADC中比较器失调(包含孔径误差与静态比较器失调)对整体性能的影响问题,本文提出了一种后台数字校准方法.该方法通过在数字域对输出余差进行统计完成误差的检测,并在模拟域调节校准DAC完成误差的校准.校准基于余差均值之差和极值之和,分别对孔径误差和静态比较器失调进行迭代提取,避免了来自其他非理想因素的影响,提高了高频信号下ADC整体性能,有效提高了校准的稳定性.该方法应用于一款2.5 GS/s 12 bit ADC中,并基于FPGA进行实现.根据实际测试结果在输入信号频率为1.91
【机 构】
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中国科学院微电子研究所,中国科学院大学
【基金项目】
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“高速高精度数模混合芯片”中国科学院战略性先导科技专项(XDC07020100)。
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为了解决超高速无采保流水线型ADC中比较器失调(包含孔径误差与静态比较器失调)对整体性能的影响问题,本文提出了一种后台数字校准方法.该方法通过在数字域对输出余差进行统计完成误差的检测,并在模拟域调节校准DAC完成误差的校准.校准基于余差均值之差和极值之和,分别对孔径误差和静态比较器失调进行迭代提取,避免了来自其他非理想因素的影响,提高了高频信号下ADC整体性能,有效提高了校准的稳定性.该方法应用于一款2.5 GS/s 12 bit ADC中,并基于FPGA进行实现.根据实际测试结果在输入信号频率为1.91
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