【摘 要】
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以雷达侦察接收机为应用背景,利用FPGA芯片并行工作的特性,设计一种并行加流水线处理模式的FFT处理器结构,实现宽带数字测频。在2.4 GSPS采样率下,选取基-2频域抽取(DIF)算法
【机 构】
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国防科学技术大学电子科学与工程学院,哈尔滨工业大学微特电机及其控制研究所
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以雷达侦察接收机为应用背景,利用FPGA芯片并行工作的特性,设计一种并行加流水线处理模式的FFT处理器结构,实现宽带数字测频。在2.4 GSPS采样率下,选取基-2频域抽取(DIF)算法,采用每通道512点流水结构FFT、8通道并行处理的设计思路,以达到单通道4 096点FFT的处理效果。在保证分辨率的同时,采样数据能够被实时处理。仿真结果显示,在300 MHz时钟下,FPGA完成4 096个数据的缓存和FFT运算只需要2.1μs,满足雷达侦察接收机对数据处理速度的要求。
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