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建立数字系统的高层次ＶＨＤＬ语言行为模型，是应用ＶＨＤＬ语言及自动综合系统以自顶向下的方法进行大规模集成电路设计的基础．以ＲＩＳＣＳＰＡＲＣＭＢ８６９０１为例，讨论建立多级复杂流水线结构的ＶＨＤＬ语言高层次行为模型的方法，同时对相关问题进行分析．
多级流水线结构高层次VHDL语言行为模型的研究
【摘 要】
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建立数字系统的高层次ＶＨＤＬ语言行为模型，是应用ＶＨＤＬ语言及自动综合系统以自顶向下的方法进行大规模集成电路设计的基础．以ＲＩＳＣＳＰＡＲＣＭＢ８６９０１为例，讨论建立多级复杂流水线结构的ＶＨＤＬ语言高层次行为模型的方法，同时对相关问题进行分析．
【机 构】
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北京理工大学ASIC研究所
【出 处】
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计算机辅助设计与图形学学报
【发表日期】
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0年JSJF904.008期
【基金项目】
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国家“九五”军事微电子预研项目,国家博士点基金
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