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介绍硬件描述语言Verilog-HDL。通过与传统的数字逻辑系统的设计方法进行比较，展现了硬件描述语言Verilog-HDL设计数字逻辑电路的优越性。
用Verilog—HDL设计数字逻辑系统
【摘 要】
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介绍硬件描述语言Verilog-HDL。通过与传统的数字逻辑系统的设计方法进行比较，展现了硬件描述语言Verilog-HDL设计数字逻辑电路的优越性。
【机 构】
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上海交通大学信息检测技术与仪器系,200030
【出 处】
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计算机工程
【发表日期】
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2000年12期
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