【摘 要】
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文章通过对1553B总线协议的研究,结合现代EDA技术,介绍了一种使用现场可编程逻辑器件(FPGA)设计1553B总线协议用的manchester Ⅱ型码解码器的方法。通过采用Verilog HDL硬件
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文章通过对1553B总线协议的研究,结合现代EDA技术,介绍了一种使用现场可编程逻辑器件(FPGA)设计1553B总线协议用的manchester Ⅱ型码解码器的方法。通过采用Verilog HDL硬件描述语言和原理图混合输入法,使设计简洁有效。通过QuartusⅡ开发软件对设计进行了时序约束和分析,最后给出了时序仿真图,从而证明了这种设计是可行和可靠的。
Through the research of 1553B bus protocol and the modern EDA technology, this paper introduces a method of designing manchester code decoder for 1553B bus protocol by using field programmable logic device (FPGA). Through the use of Verilog HDL hardware description language and schematic mixed input method, the design is simple and effective. Quartus Ⅱ development software through the timing constraints and analysis of the design, and finally gives the timing simulation diagram, which proves that this design is feasible and reliable.
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