【摘 要】
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使用VHDL硬件语言,在FPGA内部每个总线通道设计一个状态机,各通道对应配置独立缓存,实现多通道HB6096航空总线数据收发。对制成品进行测试,结果表明设计合理可靠,模块工作稳
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使用VHDL硬件语言,在FPGA内部每个总线通道设计一个状态机,各通道对应配置独立缓存,实现多通道HB6096航空总线数据收发。对制成品进行测试,结果表明设计合理可靠,模块工作稳定。该设计方法立足于国产化思路,提高了硬件集成度及数据处理效率,降低了成本,对国内同类航空总线接口国产化设计具有参考作用。
Using the VHDL hardware language, a state machine is designed for each bus channel inside the FPGA, and each channel is configured with an independent cache so as to send and receive multi-channel HB6096 airbus data. The finished products were tested, the results show that the design is reasonable and reliable, the module is stable. The design method based on localization ideas, improve the hardware integration and data processing efficiency, reduce costs, domestic similar aviation bus interface design has a reference.
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