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介绍了VHDL语言及其基本特点和VHDL强大的仿真工具Active-VHDL，并结合例子描述了VHDL语言在数字电路设计仿真调试阶段所起的重要作用，仿真通过之后需要进行综合才能完成设计工作。结合使用VHDL的仿真和综合工具进行电子设计自动化设计的实际芯片取得了令人满意的结果。
VHDL语言在电子设计自动化中的应用
【摘 要】
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介绍了VHDL语言及其基本特点和VHDL强大的仿真工具Active-VHDL，并结合例子描述了VHDL语言在数字电路设计仿真调试阶段所起的重要作用，仿真通过之后需要进行综合才能完成设计工
【机 构】
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上海交通大学电力学院
【出 处】
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电力自动化设备
【发表日期】
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2002年5期
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