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以自顶向下的模块化方法进行数字钟系统设计,采用VHDL语言编写各功能模块,原理图作为顶层文件的方式,在Quartus II集成开发环境里进行编译、仿真、综合,最后在线下载到实验箱进行调试,调试结果表明:数字钟的时间显示、调时和闹钟功能均可实现。
基于VHDL语言的数字钟设计
【摘 要】
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以自顶向下的模块化方法进行数字钟系统设计,采用VHDL语言编写各功能模块,原理图作为顶层文件的方式,在Quartus II集成开发环境里进行编译、仿真、综合,最后在线下载到实验箱
【机 构】
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中国海洋大学信息科学与工程学院
【出 处】
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科技创新与应用
【发表日期】
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2017年12期
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