【摘 要】
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在高速电路设计中,动态逻辑电路应用十分广泛。但由于缺乏内在的上拉恢复路径,动态逻辑电路对单粒子效应极其敏感。因此,相比静态逻辑电路,它们在可靠性要求较高的应用中缺乏
【基金项目】
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国家自然科学基金(61504038)
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在高速电路设计中,动态逻辑电路应用十分广泛。但由于缺乏内在的上拉恢复路径,动态逻辑电路对单粒子效应极其敏感。因此,相比静态逻辑电路,它们在可靠性要求较高的应用中缺乏吸引力。因此,基于版图布局技术,提出了两个抗单粒子效应的动态逻辑电路设计。因为敏感节点之间的电荷共享效应,单粒子瞬态脉冲得到抑制。仿真结果和实验数据验证了它们具有更高的防止单粒子效应错误的能力。
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