【摘 要】
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根据一种时间数字转换器的结构和性能。提出了组成全数字锁相环重要模块——时间数字转换器的设计方法。首先，设计出TDC模块的电路构成；其次，采用千分尺算法对电路信号进行设计
【机 构】
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浙江工业大学研究生院,浙江工业大学信息学院
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根据一种时间数字转换器的结构和性能。提出了组成全数字锁相环重要模块——时间数字转换器的设计方法。首先，设计出TDC模块的电路构成；其次，采用千分尺算法对电路信号进行设计和较正；最后，通过PSPICE仿真环境对电路图的设计，测出TDC的精确度，测得在CMOS环境下时间延迟的线性趋势。实验结果表明，与已有的时间数字转换器相比，该千分尺算法应用于TDC模块的设计，可以使时间数字转换器的性能有较大提高。
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