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给出了一种适合于高速模数转换器（ADCs）的高性能采样，保持电路的设计方法，该电路采用全差分结构、底板采样和高性能增益自举运算放大器来抑制电荷注入误差和时钟馈通误差，从而极大的减小了非线性误差，保证了较高的精度。
高性能CMOS采样保持电路的设计
【摘 要】
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给出了一种适合于高速模数转换器（ADCs）的高性能采样，保持电路的设计方法，该电路采用全差分结构、底板采样和高性能增益自举运算放大器来抑制电荷注入误差和时钟馈通误差，从而极大
【机 构】
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重庆邮电大学,模拟集成电路国家重点实验室,中国电子科技集团公司第二十四研究所
【出 处】
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电子元器件应用
【发表日期】
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2007年8期
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