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VHDL是EDA的重要组成部分,利用VHDL来设计数字频率计,极大地减少了设计电路的时间和可能发生的错误,降低开发成本。本文介绍了数字频率计的工作原理,应用VHDL设计的顶层文件及其运行结果。
数字频率计的VHDL设计
【摘 要】
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VHDL是EDA的重要组成部分,利用VHDL来设计数字频率计,极大地减少了设计电路的时间和可能发生的错误,降低开发成本。本文介绍了数字频率计的工作原理,应用VHDL设计的顶层文件
【机 构】
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浙江广播电视高等专科学校信息工程系
【出 处】
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浙江传媒学院学报
【发表日期】
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2002年1期
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