【摘 要】
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提出了一种可以显著降低伪随机码发生器功耗的ｍ序列伪随机码发生器并行实现结构。同时，还讨论并解决了并行结构设计中的开关数优化等几个关键问题，并得出相应的一般性结论。最后
【机 构】
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复旦大学专用集成电路与系统国家重点实验室
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提出了一种可以显著降低伪随机码发生器功耗的ｍ序列伪随机码发生器并行实现结构。同时，还讨论并解决了并行结构设计中的开关数优化等几个关键问题，并得出相应的一般性结论。最后，讨论了Ｍ个抽头的Ｎ阶码发生器的开关优化算法，该算法具有Ｏ（（Ｍ！）×Ｎ）的复杂度。
A parallel implementation structure of m-sequence pseudorandom code generator that can significantly reduce the power consumption of the pseudo-random code generator is proposed. At the same time, several key issues such as the optimization of the number of switches in the parallel structure design are discussed and solved, and the corresponding general conclusions are drawn. Finally, we discuss the switch optimization algorithm of M-tap N-order code generators, which has the complexity of O ((M!) × N).
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