【摘 要】
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提出了一种正交解码/计数器的电路设计,用Altera FLEX10KA FPGA实现。电路由数字滤波器、正交解码器和加/减计数器组成。数字滤波器的设计基于数据通道有限状态机模型。电路
【机 构】
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广西师范大学物理与信息工程学院 广西桂林541004
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提出了一种正交解码/计数器的电路设计,用Altera FLEX10KA FPGA实现。电路由数字滤波器、正交解码器和加/减计数器组成。数字滤波器的设计基于数据通道有限状态机模型。电路仿真和实验测试的结果验证了电路功能。
A quadrature decoder / counter circuit design is proposed using Altera FLEX10KA FPGA. The circuit consists of digital filters, quadrature decoders and up / down counters. The design of the digital filter is based on the data path finite state machine model. Circuit simulation and experimental test results verify the circuit function.
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