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该文阐述了通用异步收发器（UART）异步串行通信原理，介绍了实现UART异步串行通信的硬件接口电路及各部分硬件模块。该文基于Verilog语言实现了接收器和发送器这两个UART的内部核心功能模块，通过Modelsim对相应Verilog-HDL程序的仿真，验证了其异步串行数字接收和发送的功能。
基于VERILOG—HDL的简化异步收发器的设计与仿真
【摘 要】
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该文阐述了通用异步收发器（UART）异步串行通信原理，介绍了实现UART异步串行通信的硬件接口电路及各部分硬件模块。该文基于Verilog语言实现了接收器和发送器这两个UART的内部核
【机 构】
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辽宁工业大学电子与信息工程学院
【出 处】
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电脑知识与技术
【发表日期】
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2008年12期
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