【摘 要】
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在轨道交通安全通信系统中,为提升系统性能并降低软件复杂度,CPLD/FPGA和定制芯片等硬件产品得到广泛应用,逻辑功能仿真验证是保证上述硬件产品质量的重要环节。以SM4加解密
【机 构】
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北京全路通信信号研究设计院集团有限公司,北京市高速铁路运行控制系统工程技术研究中心
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在轨道交通安全通信系统中,为提升系统性能并降低软件复杂度,CPLD/FPGA和定制芯片等硬件产品得到广泛应用,逻辑功能仿真验证是保证上述硬件产品质量的重要环节。以SM4加解密算法模块为验证对象,采用SystemVerilog语言构建基于UVM的自动化验证平台。区别于传统的验证方法,该平台采用随机测试向量并利用DPI接口内嵌C函数模型,实现仿真数据自动化实时监控,避免单纯用人工检查,有效提高仿真验证效率。
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